Haben Sie Lust, ganz vorne dabei zu sein, wenn die Zukunft entsteht?
Das Fraunhofer-Institut für mikroelektronische Schaltungen und Systeme
in Duisburg vergibt Zum nächstmöglichen Termin eine
Das Fraunhofer-Institut für mikroelektronische Schaltungen und Systeme
in Duisburg vergibt Zum nächstmöglichen Termin eine
Abschlussarbeit zum Thema: „Continuous Deployment-Umgebung für die RISC-V Prozessorentwicklung“
Die Entwicklung moderner Prozessoren erfordert die Zusammenarbeit von großen Teams an verschiedenen Standorten. Dabei kommen wie in der Softwareentwicklung Versionskontrollsysteme zum Einsatz, mit deren Hilfe eine gemeinsame Codebasis für Hardware-Beschreibungen, Testumgebungen und Firmware gepflegt wird. Eine Herausforderung besteht darin, stets eine stabile und ausführbare, regressionsfreie Datenbasis vorzuhalten und instabile Designzustände nicht in die Datenbasis aufzunehmen.
Hilfsmittel sind dabei Continuous Deployment-Umgebungen mit sogenannten gated commits, die im Rahmen einer Abschlussarbeit erstellt werden sollen. Ziel ist es, dass jede eingecheckte Änderung an der Datenbasis automatisiert zur Erzeugung und dem Test aller Entwicklungsobjekte führt. So wird z.B. mit dem eingecheckten Verilog-Code automatisch eine Synthese durchgeführt sowie eine Netzliste erzeugt und simuliert. Aus diesen Simulationsergebnissen wird anschließend ein Report generiert. Gleichzeitig wird aus dem Verilog Code ein FPGA-Bitstream erzeugt, der auf eine Gruppe von FPGA-Testboards geladen, mit Benchmarks bespielt und getestet wird. Zusätzliche automatisierte Tests können die Einhaltung bestimmter Coding-Konventionen überprüfen oder wichtige Randbedingungen für die ASIC-Implementierung (z.B. die benötigte Chipfläche) auswerten.
Hilfsmittel sind dabei Continuous Deployment-Umgebungen mit sogenannten gated commits, die im Rahmen einer Abschlussarbeit erstellt werden sollen. Ziel ist es, dass jede eingecheckte Änderung an der Datenbasis automatisiert zur Erzeugung und dem Test aller Entwicklungsobjekte führt. So wird z.B. mit dem eingecheckten Verilog-Code automatisch eine Synthese durchgeführt sowie eine Netzliste erzeugt und simuliert. Aus diesen Simulationsergebnissen wird anschließend ein Report generiert. Gleichzeitig wird aus dem Verilog Code ein FPGA-Bitstream erzeugt, der auf eine Gruppe von FPGA-Testboards geladen, mit Benchmarks bespielt und getestet wird. Zusätzliche automatisierte Tests können die Einhaltung bestimmter Coding-Konventionen überprüfen oder wichtige Randbedingungen für die ASIC-Implementierung (z.B. die benötigte Chipfläche) auswerten.
Was Sie mitbringen
- Studium im Bereich Elektrotechnik, Informatik, Physik oder eines anderen technischen Studiengangs
- Kenntnisse im Bereich UNIX/Linux-Umgebungen
- Erfahrung im Programmieren von Skripten in einer unter Linux-Systemen üblichen Skriptsprache
- Grundlegendes Verständnis der Entwicklungsabläufe von digitalen Schaltungen (HDL-Programmierung, Synthese, Place & Route)
- Grundkenntnisse in Verilog/VHDL und in der elektrischen Labor-/Messtechnik (Umgang mit Oszilloskop, einfache Lötarbeiten)
- Eigenständige und zuverlässige Arbeitsweise, Kreativität sowie ein hohes Maß an Kommunikations- und Teamfähigkeit
Schwerbehinderte Menschen werden bei gleicher Eignung bevorzugt eingestellt.
Wir weisen darauf hin, dass die gewählte Berufsbezeichnung auch das dritte Geschlecht miteinbezieht.
Die Fraunhofer-Gesellschaft legt Wert auf eine geschlechtsunabhängige berufliche Gleichstellung.
Fraunhofer ist die größte Organisation für anwendungsorientierte Forschung in Europa. Unsere Forschungsfelder richten sich nach den Bedürfnissen der Menschen: Gesundheit, Sicherheit, Kommunikation, Mobilität, Energie und Umwelt. Wir sind kreativ, wir gestalten Technik, wir entwerfen Produkte, wir verbessern Verfahren, wir eröffnen neue Wege.
Bitte bewerben Sie sich ausschließlich online über den Button "Bewerben".
Bewerbungen per E-Mail oder Post können wir leider nicht berücksichtigen.
Bitte übermitteln Sie hierbei Ihre vollständigen Bewerbungsunterlagen (Motivationsschreiben, chronologischer Lebenslauf, aktueller Notenspiegel im Studium, Arbeitszeugnisse bisheriger beruflicher Erfahrungen/ Praktika).
Fragen zu dieser Position beantwortet gerne Frau Irini Tsiftsi:
Telefon +49 203 3783-268
E-Mail: personal@ims.fraunhofer.de
Weitere Informationen zum Institut finden Sie unter:
| Kennziffer: IMS-2020-8 | Bewerbungsfrist: |
